Turbo décodage de code produit haut débit utilisant un code BCH étendu (128,106,8) t=3

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dc.contributor.author CUEVAS, J. -
dc.contributor.author ADDE, P. -
dc.contributor.author KEROUEDAN, S. -
dc.contributor.author ARZEL, M. -
dc.contributor.author LE MASSON, J. -
dc.date.accessioned 2007-11-30T10:23:59Z
dc.date.available 2007-11-30T10:23:59Z
dc.date.issued 2003 en_US
dc.identifier.uri http://hdl.handle.net/2042/13576
dc.description.abstract - Cet article propose une nouvelle architecture de turbo décodage de codes BCH (128,106,8) à entrées et sorties pondérées corrigeant 3 erreurs. En utilisant le concept de parallélisme et les propriétés de la matrice générée par un code produit, cet article présente la conception et la complexité de trois décodeurs capables de traiter 2, 4 et 8 données en même temps pour obtenir le haut débit dans le décodage. Pour comparer les performances et la complexité entre les différents décodeurs, le langage C a été utilisé pour les simulations, le langage VHDL pour les simulations fonctionnelles et Synopsys Design Compiler pour la synthèse. Les résultats ainsi obtenus ouvrent la possibilité d'intégration sur le silicium de turbo décodeurs à fort pouvoir de correction (distance de 64, rendement de 0,8) et à haut débit (6,4Gbits/s). fr
dc.format.extent 121568 bytes
dc.format.mimetype application/pdf
dc.language.iso fr en_US
dc.publisher GRETSI, Groupe d’Etudes du Traitement du Signal et des Images en_US
dc.relation.ispartof 19° Colloque sur le traitement du signal et des images, FRA, 2003 fr
dc.rights http://irevues.inist.fr/utilisation fr
dc.source 19° Colloque sur le traitement du signal et des images, 2003 ; p. 427-430 fr
dc.title Turbo décodage de code produit haut débit utilisant un code BCH étendu (128,106,8) t=3 fr
dc.type conference-meeting-part en_US
dc.contributor.affiliation ENST Bretagne, Technopôle Brest Iroise, CS 83818, 29238 Brest, FRA fr


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